74ls161接16进制CLK

因为是手机,电路图没法给,我可以给你个方案.74ls161是异步置数同步清零十六进制计数器,构成24进制计数器有两种方法：1.异步置数法.因为是异步,所以不用等待时钟信号就可以直接置数,构成24进制计

分为十位和个位两个部分,将十位的Q1与个位的Q2相与,个位的Q3和Q0相与,再将它们的结果相或,接到清零端,如果是低有效需要取反.(Q1(SHI)*Q2)+(Q3*Q0)

74160改写成74161即可

74ls161设计24进制计数的CAD.程序的最理想的有什么要求再问：状态是1——24，用手动脉冲触发再问：用两个161

新手,注册的,不能上传图片,就给你说说吧：如果利用74160来做的话,可以这样考虑,24=2*10+4,利用2片74160做,第一片使能端接高,第二片使能端接第一片的进位端,两片D0~D3都接地,然后

你好：我才用同步置数法,74ls161和一个两路与非门搭出的四进制计数器.希望我的回答能帮助到你.

74ls161是四位同步二进制加法计数器,可用两片74ls161级联做出23进制计数器,首先第一片作低位计数,第二片作高位计数；当时钟信号一到来时,低位计数器计数一次,一共计数16次计数器本身会自动清

74ls161为单时钟同步十六进制加法计数器,附加控制端有Rd’,Ld’,ET和EP,其中Rd’为置零输入端,Ld’为置数输入端,ET和EP为保持计数状态控制端.那么你要做五进制计数器有两种方法,置零

12是1100,置c端和d端为1,a端和b端为0就可以了,其余的和普通计数器的连接一样哇

74LS161是16进制计数器,对于60进制（0-59）由于不是素数,故可以有四种方法.串接,并接,整体置数和整体置零.现在介绍一种最实用简单的方法,整体置数法.59=16*3+11,故需要使用两个7

LIBRARYIeee;USEieee.std_logic_1164.ALL;USEieee.std_logic_unsigned.ALL;ENTITYcount24ISPORT(en,clk:INS

161是模16的.一片没法弄吧~一般用390芯片,可以实现100以内任意模值计数器60==01100000将第二个,第三个输出用与非门实现清0

要俩片161!一个做低片~一个做高片!低片的要10（0~9）进制!应为161是16进制的~所以用个与非门从Q3,Q1引入与非门,出来到CR清零端.（Q3~Q0是高位到低位）,10的BCD码字是1010

一片的话很简单,12转成二进制是1100,你把高位的11与非后接MR就可以了

计数范围：0~23.LS161是同步预置,异步清零,两种方法反馈数值差1,清零法是计数到24去清零.

简单的说就是,一个上升沿,一个下降沿的时间算是一个时钟,这个可以用时间表示,也可以用频率表示

与非门3个输入端就是3个输入量与后非.然后从电路结构分析,左片为低位计数器,右片为高位计数器,左片内计数16次进位一次,右片则计数一次,当右片计数3次和左片计数一次后,此时正好49次,因为74LS16

这两个芯片，置数的操作，不是同时进行的。所以《方法2》的分析，是正确的。左边的芯片，实际上是7进制。右边的芯片，实际上是9进制。级联后，就是63进制。《方法1》的分析，适用于同时置数。

教育的目的是学以致用，把一个先进的同步计数器构成异步的分频器，连时钟相位也不同，还要加反相器，题目本身就是不妥的！我忍不住要说脏话了！这样的题目会误导学生的！同步计数器的精髓是“先进位”的概念，就是计

当时钟信号clk发生改变并且clk=1的时候前面应该是waituntil,而且一个process中这句waituntil只能出现一次如果出现了,process的sensibilitylist不用写任何